赛灵思-EDA365

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如何用单个赛灵思FPGA数字化数百个信号

在新型赛灵思FPGA上使用低电压差分信号(LVDS).只需一个电阻和一个电容就能够数字化输入信号.由于目前这一代赛灵思器件上提供有数百个LVDS输入.理论上使用单个FPGA就能够数字化数百个模拟信号.我们团队近期探索...

嵌入式开发

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发布时间：2020-07-01

典型的SDSoC设计开发的几个步骤

一个典型的SDSoC设计开发流程.包括以下几个步骤:用户定义开发应用所需的目标平台.用户基于C/C++设计和验证算法.用户根据系统特征描述确定性能瓶颈.然后进行软硬件分区.SDSoC将自动执行那些通过PL(可编程逻辑)...

嵌入式开发

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发布时间：2020-06-30

如何将System generator与MATLAB进行匹配?

system generator是xilinx公司的系统级建模工具.它是扩展mathworks公司的MATLAB下面的simulink平台.添加了XILINX FPGA专用的一些模块.加速简化了FPGA的DSP系统级硬件设计. 但是对于初学者来说.不知道什么版本的...

嵌入式开发

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发布时间：2020-06-30

如何使用Xilinx中ise原语?

1.IBUFGDS输入全局时钟及DCM分频使用:IBUFGDS#(.DIFF_TERM(FALSE), // DifferenTIal TerminaTIon (Virtex-4/5, Spartan-3E/3A).IOSTANDARD(DEFAULT) // Specifies the I/O standard for this buffer)IBUFGDS_inst ...

嵌入式开发

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发布时间：2020-06-30

赛灵思隆重推出EasyPath-6 FPGA

赛灵思公司 (Xilinx, Inc. (NASDAQ: XLNX))日前宣布隆重推出EasyPath™-6 FPGA.该产品为高性能 FPGA 进入量产器件提供了六周内即可实现的总成本最低.风险最小的的解决方案. 在所有FPGA降低成本解决方案中转入量产...

DSP系统

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FPGA
赛灵思

发布时间：2020-06-30

基于赛灵思FPGA的频率计设计

首先是将频率分频.产生1HZ频率.程序如下:--------------------------------------------------------------------- 说明: 分频模块.将标准输入频率分频为1HZ-- 文件: fenpin.vhd-- 作者:-- 日期: 2012/04/09-- ...

DSP系统

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发布时间：2020-06-28

提升创造力的数字设计工具:FPGA Editor(08-100)

工程师在设计过程中.经常需要一定的创造力(不妨称之为数字管道胶带)才能够保证设计的顺利完成.过去8年时间里.我曾经目睹许多优秀工程师利用这一方法出色地完成了许多工作.而他们采用的最主要工具就是FPGA Editor...

模拟电路设计

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发布时间：2020-06-28

Xilinx FPGA/Zynq设计中使用HLS实现OpenCV的开发流程

开源计算机视觉 (OpenCV) 被广泛用于开发计算机视觉应用.它包含2500多个优化的视频函数的函数库并且专门针对台式机处理器和GPU进行优化.Xilinx VivadoHLS高层次综合工具能够使用C/C++ 编写的代码直接创建RTL硬件....

嵌入式开发

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发布时间：2020-06-24

用OpenCV和Vivado HLS加速基于Zynq SoC的嵌入式视觉应用开发

将VivadoHLS与OpenCV库配合使用.既能实现快速原型设计.又能加快基于Zynq All ProgrammableSoC的SmarterVision系统的开发进度.计算机视觉技术几年来已发展成为学术界一个相当成熟的科研领域.目前许多视觉算法来自...

嵌入式开发

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发布时间：2020-06-24

聚焦面向Smarter视觉的Zynq SoC

ZynqAllProgrammableSoC加上全新赛灵思工具及IP.可为新一代嵌入式视觉产品奠定坚实基础.您是否看过奥迪自动停车技术演示.轿车无需驾驶员干预.便可自动找到停车位并停泊.您是否使用Kinect控制器玩过Xbox360游戏...

嵌入式开发

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发布时间：2020-06-24

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一颗引发行业变革的红外芯片

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