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赛灵思FPGA设计技巧与应用创新

上一次我们提到可以利用本地存储的训练序列与接收到的序列进行匹配滤波(相关)的方法来搜寻精确的OFDM符号起始位置.整个模块的框图如下:(1)框图的第一部分是匹配滤波器(相关器).假如我们直接调用复数乘法器...

可编程逻辑

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发布时间：2020-05-15

赛灵思FPGA设计技巧与应用创新(二)

从调制器编码理论的角度看.多数传统的模数转换器均属于线性脉冲编码调制(LPCM.Linear Pulse Code Modulation)类型.如并行比较型.逐次逼近型等.这类模数转换器根据信号的幅值大小进行量化编码.一个分辨率为n的A...

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发布时间：2020-05-15

FPGA设计中对输入信号的处理

1.输入信号为什么要寄存一般来说.在全同步设计中.如果信号来自同一时钟域.各模块的输入不需要寄存.只要满足建立时间.保持时间的约束.可以保证在时钟上升沿到来时.输入信号已经稳定.可以采样得到正确的值.但...

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发布时间：2020-05-15

3系列FPGA中使用LUT构建分布式RAM(4)

前面讲了分布式RAM的方方面面.下面以RAM_16S为例.分别给出其在VHDL和Verilog HDL下面的模板代码(在ISE Project Navigator中选择 Edit--- Language Templates.然后选择VHDL 或者Verilog, 最后是Synthesis Templat...

可编程逻辑

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发布时间：2020-05-15

3系列FPGA中使用LUT构建分布式RAM(3)

前面简要介绍了Spartan-3系列FPGA中分布式RAM的基本特性.为什么不从更高级的Virtex系列入手呢?我仔细看了一下各个系列的介绍.对比.Spartan系列基本就是Virtex系列的精简版.其基本原理是一样的.所以从简单的入...

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发布时间：2020-05-15

3系列FPGA中使用LUT构建分布式RAM(1)

在赛灵思Spartan-3.3E等系列的FPGA中.其逻辑单元CLB中一般含有不同数量的单端口RAM(SRAM)或者双端口RAM(DRAM).这里的[单"或者[双"是由我们开发人员定义的.一般情况下这种RAM分布于(distributed)FPGA的阵列...

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发布时间：2020-05-15

3系列FPGA中使用LUT构建分布式RAM(2)

分布式RAM支持以下的单口RAM与双口RAM类型:带有异步写/同步读的SRAM.其中的同步读取可以使用与分布式RAM相关联的触发器实现.带有一个同步写端口与两个异步读端口的DRAM.其中同步同步读的原理与前者相同.图1给出...

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发布时间：2020-05-15

工程师对于有关FPGA项目的九大感言

1. 要和人配合.以我们做硬件的工程师为例.测试的时候一般都需要软件的配合.一个对硬件来说无比复杂的工作.可能在软件工程师看来就是几行简单的代码.所以要和人配合.多听听别人的意见.这样必然可以产生新的 k...

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FPGA

发布时间：2020-05-15

未来只有懂FPGA开发的人才堪称计算机专家?

由于微电子和超大规模集成电路工艺技术设备的缺失.使国人根本没有条件能够自由地进入这个领域体验.这是一个严重的问题.在25nm集成电路工艺已经十分成熟的今天.如果我们还不设法从国家的角度出发.买进设备(即使...

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发布时间：2020-05-15

Verilog代码设计案例分析

Verilog以其灵活性而得到大部分FPGA设计者的喜爱.然而有些时候.这些灵活性也带来一些小问题.因此我们要记住.电脑永远没人我们聪明.我们一定要提前知道代码会被综合成什么样子.下面举一个有趣的例子.假如定义...

可编程逻辑

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发布时间：2020-05-15

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