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ST-BUS总线接口模块的Verilog HDL设计

ST-BUS是广泛应用于E1通信设备内部的一种模块间通信总线.结合某专用通信系统E1接口转换板的设计.本文对ST-BUS总线进行了介绍.讨论了ST-BUS总线接口收发模块的设计方法.给出了VerilogHDL实现和模块的时序仿真图....

嵌入式开发

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发布时间：2020-06-28

verilog中阻塞赋值和非阻塞赋值

阻塞和非阻塞语句作为verilogHDL语言的最大难点之一.一直困扰着FPGA设计者.即使是一个颇富经验的设计工程师.也很容易在这个点上犯下一些不必要的错误.阻塞和非阻塞可以说是血脉相连.但是又有着本质的差别.理解...

嵌入式开发

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verilog
阻塞

发布时间：2020-06-28

Verilog HDL与VHDL及FPGA的比较分析

VerilogHDL优点:类似C语言.上手容易.灵活.大小写敏感.在写激励和建模方面有优势.缺点:很多错误在编译的时候不能被发现.VHDL优点:语法严谨.层次结构清晰.缺点:熟悉时间长.不够灵活.FPGA优点:设计周期...

嵌入式开发

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发布时间：2020-06-24

采用Verilog的数字跑表设计

本节通过VerilogHDL语言编写一个具有[百分秒.秒.分"计时功能的数字跑表.可以实现一个小时以内精确至百分之一秒的计时.数字跑表的显示可以通过编写数码管显示程序来实现.本实例只给出数字跑表的实现过程.读者还...

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发布时间：2020-06-23

基于FPGA和硬件描述语言Verilog的液晶显示控制器的设计

本设计是一种基于FPGA(现场可编程门阵列)的液晶显示控制器.与集成电路控制器相比.FPGA更加灵活.可以针对小同的液晶显示模块更改时序信号和显示数据.FPGA的集成度.复杂度和面积优势使得其日益成为一种颇具吸引力...

嵌入式开发

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发布时间：2020-06-23

verilog PS2键盘解码程序

之前探讨过PS/2键盘编解码以及数据传输协议.这次自己动手实现了利用FPGA接收键盘编码.然后通过串口传输到PC.做的比较简单.只是通过FPGA把大写字母A-Z转换成相应的ASCII码.只要字母按键被按下.就能在串口调试助...

嵌入式开发

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发布时间：2020-06-22

好用的Verilog串口UART程序

==========================================================================//-----------------------------------------------------// Design Name : uart // File Name : uart.v// Function : Simple UART// ...

嵌入式开发

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发布时间：2020-06-22

ChipDesign ISE 11 设计工具视点

作为一个负责FPGA企业市场营销团队工作的人.我不得不说.由于在工艺技术方面的显著成就以及硅芯片设计领域的独创性.FPGA正不断实现其支持片上系统设计的承诺.随着每一代新产品的推出.FPGA 在系统中具有越来来越...

嵌入式开发

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发布时间：2020-06-20

H.264/AVC中量化的Verilog方法介绍及实现

0 引言H.264作为新一代的视频压缩标准.是由ITU-T的视频编码专家组和ISO／IEC的MPEG(运动图像编码专家组)成立的联合视频小组共同开发的.它优异的压缩性能也将在数字电视广播.视频实时通信.网络视频流媒体传递以...

嵌入式开发

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发布时间：2020-06-20

基于FPGA和DDS的信号源设计

1 引言直接数字频率合成DDS(Direct Digital Synthesizer)是基于奈奎斯特抽样定理理论和现代器件生产技术发展的一种新的频率合成技术.与第二代基于锁相环频率合成技术相比.DDS具有频率切换时间短.频率分辨率高.相...

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发布时间：2020-06-20

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