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soc
SOC中多片嵌入式SRAM的DFT实现方法
本文基于MBIST的一般测试方法来对多片SRAM的可测试设计进行优化.提出了一种通过一个MBIST控制逻辑来实现多片SRAM的MBIST测试的优化方法. 1 MBIST介绍 MBIST意即存储器内建自测试(Memory Build In Self Test)...
存储技术
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嵌入式
dft
soc
SRAM
发布时间:2020-05-15
ASIC和FPGA的界限日益模糊.它们还有什么区别
随着处理器被添加到传统FPGA中.可编程性被添加到ASIC中.FPGA和ASIC的分界线日益模糊.FPGA变得比之前更加流行了.现在的FPGA不再只是查找表(LUT)和寄存器的简单组合了.它已经成为系统探索的架构.以及验证未来A...
可编程逻辑
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FPGA
soc
可编程逻辑
ASIC
发布时间:2020-05-15
为应用选择最佳可编程SoC时应进行的六个设计考虑
SoC FPGA器件在一个器件中同时集成了处理器和FPGA体系结构.将两种技术合并起来具有很多优点.包括更高的集成度.更低的功耗.更小的电路板面积.以及处理器和FPGA之间带宽更大的通信等等.这一同类最佳的器件发挥了...
可编程逻辑
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FPGA
soc
altera
发布时间:2020-05-15
为应用选择最佳可编程SoC时进行的六个设计考虑
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可编程逻辑
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FPGA
soc
altera
发布时间:2020-05-15
VERTIGO (IST 033709)嵌入式系统设计验证平台
第六期研究框架计划中的一个战略目标研究项目 – 优先级2.信息社会科技项目中国.2007年2月1日 – 代号为VERTIGO(嵌入式系统设计验证平台)的战略目标研究项目致力于确保欧洲电子工业在嵌入式系统领域继续保持竞争优...
嵌入式开发
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建模
soc
可配置
发布时间:2020-05-15
飞思卡尔通过IPextreme 开放Power Architecture e200 核心系列许可
两位 Power.org 成员达成协议.提供四个e200 核心系列用于片上系统和特定应用设计加州圣何塞(嵌入式系统大会)讯-2007年4月2日-飞思卡尔半导体扩展了Power Architecture 技术在嵌入式系统市场中的使用.该公司将...
嵌入式开发
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soc
模块
封装
架构
发布时间:2020-05-15
动态时钟停止重启太快.可通过编程LPDDR2控制器解决
描述在没有内存事务处理执行以及如果接收到内存请求重启时钟时.用户可通过编程 LPDDR2 控制器来停止 DRAM 时钟.当事务处理队列为空时.该控制器会适当停止时钟.但在时钟重启时.控制器会迅速发布 DRAM 事务处理....
可编程逻辑
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soc
DRAM
发布时间:2020-05-15
关于FPGA的功耗评估需要知道些什么
经常接到工程师的电话.问所选择的FPGA或SOC的功耗情况.有没有典型值.其实针对功耗设计.工程师可以在设计的各个阶段更加准确把握.以xilinx FPGA为例:1.项目设计初期项目设计初期会选型.工程师根据资源.IO.硬...
可编程逻辑
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FPGA
soc
Xilinx
发布时间:2020-05-15
新一代SoC FPGA提供系统可信根,防止关键数据受到网络攻击
嵌入式系统设计人员有了新的网络安全武器.可以保证信息安全.防止篡改和建立可信任的系统.物联网(IoT)的规模和复杂性不断上升.对主动的强化安全措施的需求日益增加.仅利用软件安全功能已经不足以应对已知的网络...
可编程逻辑
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FPGA
soc
网络攻击
发布时间:2020-05-15
Tensilica 106Micro新添ThreadX RTOS支持
Express Logic公司日前宣布在免版税实时操作系统领域提供ThreadX RTOS和中间件支持Tensilica Diamond Standard 106Micro 32位微控制器IP核. ThreadX是Express Logic针对高要求实时应用小面积速度快免版税的RTOS...
嵌入式开发
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soc
存储
eda
控制
发布时间:2020-05-15
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